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PCB设计的布局、走线与电磁兼容（二）
日期：2024-05-07 05:28
浏览次数：121
摘要：其他方面的要求
48 布局考虑到总体走线的顺畅，主要数据流向合理。
49 根据布局结果调整排阻、FPGA、EPLD、总线驱动等器件的管脚分配以使布线*优化。
50 布局考虑到适当增大密集走线处的空间，以避免不能布通的情况。
51 如采取特殊材料、特殊器件（如0.5mmBGA等）、特殊工艺，已经充分考虑到到货期限、可加工性，且得到PCB厂家、工艺人员的确认。
52 扣板连接器的管脚对应关系已得到确认，以防止扣板连接器方向、方位搞反。
53 如有ICT测试要求，布局时考虑到ICT测试点添加的可行性，以免布线阶段...
其他方面的要求
48 布局考虑到总体走线的顺畅，主要数据流向合理。
49 根据布局结果调整排阻、FPGA、EPLD、总线驱动等器件的管脚分配以使布线*优化。
50 布局考虑到适当增大密集走线处的空间，以避免不能布通的情况。
51 如采取特殊材料、特殊器件（如0.5mmBGA等）、特殊工艺，已经充分考虑到到货期限、可加工性，且得到PCB厂家、工艺人员的确认。
52 扣板连接器的管脚对应关系已得到确认，以防止扣板连接器方向、方位搞反。
53 如有ICT测试要求，布局时考虑到ICT测试点添加的可行性，以免布线阶段添加测试点困难。
54 含有高速光模块时，布局优先考虑光口收发电路。
55 布局完成后已提供1：1装配图供项目人对照器件实体核对器件封装选择是否正确。
56 开窗处已考虑内层平面成内缩，并已设置合适的禁止布线区。
PCB LAYOUT三种特殊走线技巧
今天小编从直角走线，差分走线，蛇形线三个方面阐述PCB LAYOUT的走线技巧：
一、直角走线 （三个方面）
直角走线的对信号的影响就是主要体现在三个方面：一是拐角可以等效为传输线上的容性负载，减缓上升时间；二是阻抗不连续会造成信号的反射；三是直角**产生的EMI，到10GHz以上的RF设计领域，这些小小的直角都可能成为高速问题的重点对象。
二、差分走线 （“等长、等距、参考平面”）
何为差分信号（Differential Signal）？通俗地说就是驱动端发送两个等值、反相的信号，接收端通过比较这两个电压的差值来判断逻辑状态“0”还是“1”。而承载差分信号的那一对走线就称为差分走线。差分信号和普通的单端信号走线相比，*明显的优势体现在以下三方面：
1、抗干扰能力强，因为两根差分走线之间的耦合很好，当外界存在噪声干扰时，几乎是同时被耦合到两条线上，而接收端关心的只是两信号的差值，所以外界的共模噪声可被完全抵消。
2、能有效抑制EMI，同样的道理，由于两根信号的极性相反，他们对外辐射的电磁场可以相互抵消，耦合的越紧密，泄放到外界的电磁能量越少。
3、时序定位**，由于差分信号的开关变化是位于两个信号的交点，而不像普通单端信号依靠高低两个阈值电压判断，因而受工艺，温度的影响小，能降低时序上的误差，同时也更适合于低幅度信号的电路。目前流行的LVDS（low voltage differential signaling）就是指这种小振幅差分信号技术。
三、蛇形线 (调节延时)
蛇形线是Layout中经常使用的一类走线方式。其主要目的就是为了调节延时，满足系统时序设计要求。其中*关键的两个参数就是平行耦合长度（Lp）和耦合距离（S），很明显，信号在蛇形走线上传输时，相互平行的线段之间会发生耦合，呈差模形式，S越小，Lp越大，则耦合程度也越大。可能会导致传输延时减小，以及由于串扰而大大降低信号的质量，其机理可以参考对共模和差模串扰的分析。下面是给Layout工程师处理蛇形线时的几点建议：
1、尽量增加平行线段的距离（S），至少大于3H，H指信号走线到参考平面的距离。通俗的说就是绕大弯走线，只要S足够大，就几乎能完全避免相互的耦合效应。
2、减小耦合长度Lp，当两倍的Lp延时接近或超过信号上升时间时，产生的串扰将达到饱和。
3、带状线（Strip-Line）或者埋式微带线（Embedded Micro-strip）的蛇形线引起的信号传输延时小于微带走线（Micro-strip）。理论上，带状线不会因为差模串扰影响传输速率。
4、高速以及对时序要求较为严格的信号线，尽量不要走蛇形线，尤其不能在小范围内蜿蜒走线。
5、可以经常采用任意角度的蛇形走线，能有效的减少相互间的耦合。
6、高速PCB设计中，蛇形线没有所谓滤波或抗干扰的能力，只可能降低信号质量，所以只作时序匹配之用而无其它目的。
7、有时可以考虑螺旋走线的方式进行绕线，仿真表明，其效果要优于正常的蛇形走线。
PCB技术中的电磁的兼容性
电磁兼容性（EMC， Electromagnetic Compatibility）是指电子设备在各种电磁环境中仍能够协调、有效地进行工作的能力。电磁兼容性设计的目的是使电子设备既能抑制各种外来的干扰，使电子设备在特定的电磁环境中能够正常工作，同时又能减少电子设备本身对其它电子设备的电磁干扰。印刷电路板（PCB）设计中的电磁兼容性涉及多方面因数，以下主要从三大部分加以阐述，具体选择要综合各方面因数。
一 印刷电路板整体布局及器件布置
1.一个产品的成功与否，一是要注重内在质量，二是兼顾整体的美观，两者都较**才能认为该产品是成功的；在一个PCB板上，元件的布局要求要均衡，疏密有序，不能头重脚轻或一头沉，过孔要尽量少；电路板的*佳形状为矩形。长宽比为3：2或4：3；4 层板比双面板噪声低20dB.6层板比4层板噪声低10dB.经济条件允许时尽量用多层板。
2.电路板一般分模拟电路区（怕干扰），数字电路区（怕干扰、又产生干扰），功率驱动区（干扰源），故步板时要合理地分成三区。
3.器件一般选择功耗低，稳定性好的器件，而且尽量少用高速器件。
4.线条有讲究：有条件做宽的线决不做细；高压及高频线应园滑，不得有尖锐的倒角，拐弯也不得采用直角。地线应尽量宽，*好使用大面积敷铜，这对接地点问题有相当大的改善。
5.外时钟是高频的噪声源，除能引起对本应用系统的干扰之外，还可能产生对外界的干扰，使电磁兼容检测不能达标。在对系统可靠性要求很高的应用系统中，选用频率低的单片机是降低系统噪声的原则之一。以8051单片机为例，*短指令周期1？s时，外时钟是12MHz.而同样速度的Motorola 单片机系统时钟只需4MHz，更适合用于工控系统。近年来，一些生产8051兼容单片机的厂商也采用了一些新技术，在不牺牲运算速度的前提下将对外时钟的需求降至原来的1/3.而Motorola 单片机在新推出的68HC08系列以及其16/32位单片机中普遍采用了内部锁相环技术，将外部时钟频率降至32KHz，而内部总线速度却提高到8MHz乃至更高。
6.布线要有合理的走向：如输入/输出，交流/直流，强/弱信号，高频/低频，高压/低压等……，它们的走向应该是呈线形的（或分离），不得相互交融。其目的是防止相互干扰。*好的走向是按直线，但一般不易实现，*不利的走向是环形。对于是直流，小信号，低电压PCB设计的要求可以低些。所以“合理”是相对的。上下层之间走线的方向基本垂直。整个板子的不想要均匀，能不挤的不要挤在一齐。
7.在器件布置方面与其它逻辑电路一样，应把相互有关的器件尽量放得靠近些，这样可以获得较好的抗噪声效果。时钟发生器、晶振和CPU的时钟输入端都易产生噪声，要相互靠近些，特别是晶振下方不要走信号线。易产生噪声的器件、小电流电路、大电流电路等应尽量远离逻辑电路，如有可能，应另做电路板，这一点十分重要。
二 地线技术
1.模拟电路和数字电路在元件布局图的设计和布线方法上有许多相同和不同之处。模拟电路中，由于放大器的存在，由布线产生的极小噪声电压，都会引起输出信号的严重失真，在数字电路中，TTL噪声容限为0.4V～0.6V，CMOS噪声容限为Vcc的0.3～0.45倍，故数字电路具有较强的抗干扰的能力。良好的电源和地总线方式的合理选择是仪器可靠工作的重要保证，相当多的干扰源是通过电源和地总线产生的，其中地线引起的噪声干扰*大。
2.数字地与模拟地分开（或一点接地），地线加宽，要根据电流决定线宽，一般来说越粗越好（100mil线经约通过1到2A的电流）。地线＞电源线＞信号线是线宽的合理选择。
3.电源线和地线尽可能靠近，整块印刷板上的电源与地要呈“井”字形分布，以便使分布线电流达到均衡。
4.为减少线间串扰，必要时可增加印刷线条间距离，在其安插一些零伏线作为线间隔离。特别是输入输出信号间，
三 去耦、滤波、隔离三大技术
1.去耦、滤波、隔离是硬件抗干扰常用的三大措施。
2.电源输入端跨接10~100uf的电解电容器。如有可能，接100uF以上的更好；原则上每个集成电路芯片都应布置一个0.01pF的瓷片电容，如遇印制板空隙不够，可每4~8个芯片布置一个1~10pF的但电容；对于抗噪能力弱、关断时电源变化大的器件，如RAM、ROM存储器件，应在芯片的电源线和地线之间直接接入退藕电容；
3.滤波指各类信号按频率特性分类并控制它们的方向。常用的有各种低通滤波器、高通滤波器、带通滤波器。低通滤波器用在接入的交流电源线上，旨在让50周的交流电顺利通过，将其它高频噪声导入大地。低通滤波器的配置指标是插入损耗，选择的低通滤波器插入损耗过低起不到抑制噪声的作用，而过高的插入损耗会导致“漏电”，影响系统的人身**性。高通、带通滤波器则应根据系统中对信号的处理要求选择使用。
4.典型的信号隔离是光电隔离。使用光电隔离器件将单片机的输入输出隔离开，一方面使干扰信号不得进入单片机系统，另一方面单片机系统本身的噪声也不会以传导的方式传播出去。屏蔽则是用来隔离空间辐射的，对噪声特别大的部件，如开关电源，用金属盒罩起来，可减少噪声源对单片机系统的干扰。对特别怕干扰的模拟电路，如高灵敏度的弱信号放大电路可屏蔽起来。而重要的是金属屏蔽本身必须接真正的地。
48 布局考虑到总体走线的顺畅，主要数据流向合理。
49 根据布局结果调整排阻、FPGA、EPLD、总线驱动等器件的管脚分配以使布线*优化。
50 布局考虑到适当增大密集走线处的空间，以避免不能布通的情况。
51 如采取特殊材料、特殊器件（如0.5mmBGA等）、特殊工艺，已经充分考虑到到货期限、可加工性，且得到PCB厂家、工艺人员的确认。
52 扣板连接器的管脚对应关系已得到确认，以防止扣板连接器方向、方位搞反。
53 如有ICT测试要求，布局时考虑到ICT测试点添加的可行性，以免布线阶段添加测试点困难。
54 含有高速光模块时，布局优先考虑光口收发电路。
55 布局完成后已提供1：1装配图供项目人对照器件实体核对器件封装选择是否正确。
56 开窗处已考虑内层平面成内缩，并已设置合适的禁止布线区。
PCB LAYOUT三种特殊走线技巧
今天小编从直角走线，差分走线，蛇形线三个方面阐述PCB LAYOUT的走线技巧：
一、直角走线 （三个方面）
直角走线的对信号的影响就是主要体现在三个方面：一是拐角可以等效为传输线上的容性负载，减缓上升时间；二是阻抗不连续会造成信号的反射；三是直角**产生的EMI，到10GHz以上的RF设计领域，这些小小的直角都可能成为高速问题的重点对象。
二、差分走线 （“等长、等距、参考平面”）
何为差分信号（Differential Signal）？通俗地说就是驱动端发送两个等值、反相的信号，接收端通过比较这两个电压的差值来判断逻辑状态“0”还是“1”。而承载差分信号的那一对走线就称为差分走线。差分信号和普通的单端信号走线相比，*明显的优势体现在以下三方面：
1、抗干扰能力强，因为两根差分走线之间的耦合很好，当外界存在噪声干扰时，几乎是同时被耦合到两条线上，而接收端关心的只是两信号的差值，所以外界的共模噪声可被完全抵消。
2、能有效抑制EMI，同样的道理，由于两根信号的极性相反，他们对外辐射的电磁场可以相互抵消，耦合的越紧密，泄放到外界的电磁能量越少。
3、时序定位**，由于差分信号的开关变化是位于两个信号的交点，而不像普通单端信号依靠高低两个阈值电压判断，因而受工艺，温度的影响小，能降低时序上的误差，同时也更适合于低幅度信号的电路。目前流行的LVDS（low voltage differential signaling）就是指这种小振幅差分信号技术。
三、蛇形线 (调节延时)
蛇形线是Layout中经常使用的一类走线方式。其主要目的就是为了调节延时，满足系统时序设计要求。其中*关键的两个参数就是平行耦合长度（Lp）和耦合距离（S），很明显，信号在蛇形走线上传输时，相互平行的线段之间会发生耦合，呈差模形式，S越小，Lp越大，则耦合程度也越大。可能会导致传输延时减小，以及由于串扰而大大降低信号的质量，其机理可以参考对共模和差模串扰的分析。下面是给Layout工程师处理蛇形线时的几点建议：
1、尽量增加平行线段的距离（S），至少大于3H，H指信号走线到参考平面的距离。通俗的说就是绕大弯走线，只要S足够大，就几乎能完全避免相互的耦合效应。
2、减小耦合长度Lp，当两倍的Lp延时接近或超过信号上升时间时，产生的串扰将达到饱和。
3、带状线（Strip-Line）或者埋式微带线（Embedded Micro-strip）的蛇形线引起的信号传输延时小于微带走线（Micro-strip）。理论上，带状线不会因为差模串扰影响传输速率。
4、高速以及对时序要求较为严格的信号线，尽量不要走蛇形线，尤其不能在小范围内蜿蜒走线。
5、可以经常采用任意角度的蛇形走线，能有效的减少相互间的耦合。
6、高速PCB设计中，蛇形线没有所谓滤波或抗干扰的能力，只可能降低信号质量，所以只作时序匹配之用而无其它目的。
7、有时可以考虑螺旋走线的方式进行绕线，仿真表明，其效果要优于正常的蛇形走线。
PCB技术中的电磁的兼容性
电磁兼容性（EMC， Electromagnetic Compatibility）是指电子设备在各种电磁环境中仍能够协调、有效地进行工作的能力。电磁兼容性设计的目的是使电子设备既能抑制各种外来的干扰，使电子设备在特定的电磁环境中能够正常工作，同时又能减少电子设备本身对其它电子设备的电磁干扰。印刷电路板（PCB）设计中的电磁兼容性涉及多方面因数，以下主要从三大部分加以阐述，具体选择要综合各方面因数。
一 印刷电路板整体布局及器件布置
1.一个产品的成功与否，一是要注重内在质量，二是兼顾整体的美观，两者都较**才能认为该产品是成功的；在一个PCB板上，元件的布局要求要均衡，疏密有序，不能头重脚轻或一头沉，过孔要尽量少；电路板的*佳形状为矩形。长宽比为3：2或4：3；4 层板比双面板噪声低20dB.6层板比4层板噪声低10dB.经济条件允许时尽量用多层板。
2.电路板一般分模拟电路区（怕干扰），数字电路区（怕干扰、又产生干扰），功率驱动区（干扰源），故步板时要合理地分成三区。
3.器件一般选择功耗低，稳定性好的器件，而且尽量少用高速器件。
4.线条有讲究：有条件做宽的线决不做细；高压及高频线应园滑，不得有尖锐的倒角，拐弯也不得采用直角。地线应尽量宽，*好使用大面积敷铜，这对接地点问题有相当大的改善。
5.外时钟是高频的噪声源，除能引起对本应用系统的干扰之外，还可能产生对外界的干扰，使电磁兼容检测不能达标。在对系统可靠性要求很高的应用系统中，选用频率低的单片机是降低系统噪声的原则之一。以8051单片机为例，*短指令周期1？s时，外时钟是12MHz.而同样速度的Motorola 单片机系统时钟只需4MHz，更适合用于工控系统。近年来，一些生产8051兼容单片机的厂商也采用了一些新技术，在不牺牲运算速度的前提下将对外时钟的需求降至原来的1/3.而Motorola 单片机在新推出的68HC08系列以及其16/32位单片机中普遍采用了内部锁相环技术，将外部时钟频率降至32KHz，而内部总线速度却提高到8MHz乃至更高。
6.布线要有合理的走向：如输入/输出，交流/直流，强/弱信号，高频/低频，高压/低压等……，它们的走向应该是呈线形的（或分离），不得相互交融。其目的是防止相互干扰。*好的走向是按直线，但一般不易实现，*不利的走向是环形。对于是直流，小信号，低电压PCB设计的要求可以低些。所以“合理”是相对的。上下层之间走线的方向基本垂直。整个板子的不想要均匀，能不挤的不要挤在一齐。
7.在器件布置方面与其它逻辑电路一样，应把相互有关的器件尽量放得靠近些，这样可以获得较好的抗噪声效果。时钟发生器、晶振和CPU的时钟输入端都易产生噪声，要相互靠近些，特别是晶振下方不要走信号线。易产生噪声的器件、小电流电路、大电流电路等应尽量远离逻辑电路，如有可能，应另做电路板，这一点十分重要。
二 地线技术
1.模拟电路和数字电路在元件布局图的设计和布线方法上有许多相同和不同之处。模拟电路中，由于放大器的存在，由布线产生的极小噪声电压，都会引起输出信号的严重失真，在数字电路中，TTL噪声容限为0.4V～0.6V，CMOS噪声容限为Vcc的0.3～0.45倍，故数字电路具有较强的抗干扰的能力。良好的电源和地总线方式的合理选择是仪器可靠工作的重要保证，相当多的干扰源是通过电源和地总线产生的，其中地线引起的噪声干扰*大。
2.数字地与模拟地分开（或一点接地），地线加宽，要根据电流决定线宽，一般来说越粗越好（100mil线经约通过1到2A的电流）。地线＞电源线＞信号线是线宽的合理选择。
3.电源线和地线尽可能靠近，整块印刷板上的电源与地要呈“井”字形分布，以便使分布线电流达到均衡。
4.为减少线间串扰，必要时可增加印刷线条间距离，在其安插一些零伏线作为线间隔离。特别是输入输出信号间，
三 去耦、滤波、隔离三大技术
1.去耦、滤波、隔离是硬件抗干扰常用的三大措施。
2.电源输入端跨接10~100uf的电解电容器。如有可能，接100uF以上的更好；原则上每个集成电路芯片都应布置一个0.01pF的瓷片电容，如遇印制板空隙不够，可每4~8个芯片布置一个1~10pF的但电容；对于抗噪能力弱、关断时电源变化大的器件，如RAM、ROM存储器件，应在芯片的电源线和地线之间直接接入退藕电容；
3.滤波指各类信号按频率特性分类并控制它们的方向。常用的有各种低通滤波器、高通滤波器、带通滤波器。低通滤波器用在接入的交流电源线上，旨在让50周的交流电顺利通过，将其它高频噪声导入大地。低通滤波器的配置指标是插入损耗，选择的低通滤波器插入损耗过低起不到抑制噪声的作用，而过高的插入损耗会导致“漏电”，影响系统的人身**性。高通、带通滤波器则应根据系统中对信号的处理要求选择使用。
4.典型的信号隔离是光电隔离。使用光电隔离器件将单片机的输入输出隔离开，一方面使干扰信号不得进入单片机系统，另一方面单片机系统本身的噪声也不会以传导的方式传播出去。屏蔽则是用来隔离空间辐射的，对噪声特别大的部件，如开关电源，用金属盒罩起来，可减少噪声源对单片机系统的干扰。对特别怕干扰的模拟电路，如高灵敏度的弱信号放大电路可屏蔽起来。而重要的是金属屏蔽本身必须接真正的地。
